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HDL "Frühschoppen | Stuttgart

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HDL "Frühschoppen | Stuttgart


Sie kennen ja sicher den Begriff Lunch & Learn. Wir haben das Konzept auf den Kopf gestellt und lernen vor dem Lunch.
Beim HDL „Frühshoppen“ stimulieren wir die grauen Zellen und zur Belohnung gibt es ein leckeres Mittagessen, bei dem man das Gelernte noch weiter diskutieren kann.
Im ersten HDL „Frühschoppen“ 2019 haben wir uns für das Thema „Voll-automatisierte formale Lösungen für heutige FPGA-Verifikationsherausforderungen“ entschieden.

Stefan Bauer, einer von Mentors Verifikationsexperten, wird bei dieser Veranstaltung formale Techniken zeigen, um CDC-Probleme (Clock Domain Crossing) zu überprüfen und Fehler aufgrund von RTL-Codierungsfehlern zu finden. Außerdem lernen Sie, wie Sie die formalen Apps von Mentor innerhalb der FPGA-Hersteller-Tools wie Xilinx Vivado oder Intel Quartus einsetzen.

Um das Lernprogramm der grauen Zellen abzuschließen gibt es dann auch etwas für den Magen und das Wohlbefinden :) Selbstverständlich ist die Teilnahme kostenlos.



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Map Schlachthof StuttgartSchlachthofstraße 2, 70188 Stuttgart, Germany, Stuttgart, Germany
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TRIAS Mikroelektronik GmbH
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